第3章逻辑门电路.ppt
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1、2019年6月17日,北京理工大学 信息科学学院,1,第3章 逻辑门电路,3.1 概述,本章介绍与基本逻辑运算和复合逻辑运算相对应的单元电路称为门电路。常用的门电路有“与”门、“或”门、“非”门、“与非”门、“或非”门、“与或非”门和“异或”门等。,构成门电路的器件主要有两种:,TTL(Transistor-Transistor Logic)双极型晶体管数字集成电路。,CMOS(Complement Metal-Oxide-Semiconductor) MOS晶体管数字集成电路。,2019年6月17日,北京理工大学 信息科学学院,2,3.2 晶体管的开关作用,3.2.1 二极管的开关作用,20
2、19年6月17日,北京理工大学 信息科学学院,3,3.2.2 三极管的开关特性,晶体管的工作区分为3部分:截止区、放大区、饱和区。如下图所示:,2019年6月17日,北京理工大学 信息科学学院,4,(1)截止状态,截止状态的特点:,iB 0, iC 0 ,uCE = UCC。,uBE 0 v(反偏), uBC 0 v(反偏)。,2019年6月17日,北京理工大学 信息科学学院,5,(2)放大状态,放大状态的特点:,uCE = UCC- iCRC。,iC iB 。,uBE 0.7 v(正偏),uBC 0 v(反偏)。,2019年6月17日,北京理工大学 信息科学学院,6,(3)饱和状态,1.临界
3、饱和状态:,iC iB = IC(sat),uBE 0.7 v(正偏),uBC = 0 v(零偏)。,IC(sat) =,2019年6月17日,北京理工大学 信息科学学院,7,2.过饱和状态:,uBE 0.7 v(正偏),uBC 0 v(正偏)。,在过饱和时,uCE之所以变成小于0.3v,是由于如下的原因:,2019年6月17日,北京理工大学 信息科学学院,8,负载线方程为:uCE= uO=UCC iCRC,2019年6月17日,北京理工大学 信息科学学院,9,在数字电路中,晶体管只工作在截止与饱和导通这两种状态。,双极型三极管的开关等效电路 (a)截止状态 (b)饱和导通状态,2019年6月
4、17日,北京理工大学 信息科学学院,10,在数字电路中,晶体管只工作在截止与饱和导通这两种状态。,今后一般采用正逻辑。,2019年6月17日,北京理工大学 信息科学学院,11,当三极管在截止与饱和导通之间迅速转换时,三极管内部基区存储电荷的积累和消散都需要一定的时间。,集电极电流ic的变化总是滞后于基极电压uBE的变化,故输出电压uO的变化也必然滞后于输入电压uI的变化。,通常把uO的下降沿滞后于uI上升沿的时间称为开通时间ton,它反映了三极管从截止到饱和导通所需要的时间;而把uO上升沿滞后于uI下降沿的时间称为关断时间toff ,它反映了三极管从饱和导通到截止所需要的时间。,2019年6月
5、17日,北京理工大学 信息科学学院,12,3.3 基本逻辑门电路,1.二极管“与”门,对输入端A、B、C的输入电平和输出端Y的输出电平做如下规定: 0 0.3v为逻辑“0”; 3v以上为逻辑“1”;,输入端A、B、C中只要有一个(或两个、或全部)输入为0v(逻辑“0”)则输出端Y的电平就是0.3v(逻辑“0”)。,二极管均为锗管,正向导通压降为0.2 0.3v。,2019年6月17日,北京理工大学 信息科学学院,13,3.3 基本逻辑门电路,1.二极管“与”门,输入端A、B、C全部输入为3v(逻辑“1”)则输出端Y的电平为3.3v(逻辑“1”)。,这是一个“与”门: Y = ABC。,2019
6、年6月17日,北京理工大学 信息科学学院,14,2.二极管“或”门,输入端A、B、C中只要有一个(或两个、或全部)输入为3.3v(逻辑“1”)则输出端Y的电平就是3v(逻辑“1”)。,输入端A、B、C全部输入为0.3v(逻辑“0”)则输出端Y的电平为0v(逻辑“0”)。,这是一个“或”门:Y = A+B+C。,2019年6月17日,北京理工大学 信息科学学院,15,2019年6月17日,北京理工大学 信息科学学院,16,3.三极管“非”门,输入端A为0v(逻辑“0”)三极管截止,则输出端Y的电平约为3.0v(逻辑“1”)。,输入端A为3v(逻辑“1”)三极管饱和导通,则输出端Y的电平约为0.3
7、v(逻辑“0”)。,2019年6月17日,北京理工大学 信息科学学院,17,3.4 TTL集成门电路,3.4.1 TTL与非门的基本原理,A、B为输入端,Y为输出端。,T1为多发射极晶体管。,D1、D1为输入保护钳位二极管。,T2为助推晶体管。,T4为上拉晶体管。,T5为输出晶体管。,D3为输出二极管。,2019年6月17日,北京理工大学 信息科学学院,18,多发射极三极管 符号及等效电路,2019年6月17日,北京理工大学 信息科学学院,19,UB1=0.7+0.3=1v, T1饱和, UCE1=0.1v。,UB2=0.1+0.3=0.4v, T2截止, T5亦截止。,UCC通过R2给T4供
8、以基流IB4, T4、D3导通(在输出端接负载时)。,IB4很小,在R2上的压降亦很小 (约0.2v)。,输出电压:,UY =UCC (UR2 + UBE4 + UD3) = 5 (0.2 + 0.7 + 0.7) = 3.4v(高电平UH),(1)A、B有一端为低电平(UL=0.3v),2019年6月17日,北京理工大学 信息科学学院,20,电流IB1流向T1集电极, T2饱和, T5亦饱和。UB1= 0.73 = 2.1 v。,UB4 = UCE2+UBE5 = 0.3 + 0.7 = 1.0 v。,UB4 UY =1.0 0.3 = 0.7v这不足以使T4、D3导通。所以T4、D3截止。
9、,(2)A、B同时为高电平(UH = 3.4v),输出电压:UY =UCE5= 0.3 v (低电平UL)。,2019年6月17日,北京理工大学 信息科学学院,21,推拉式输出级,这种T4、T5相串联的输出结构叫做推拉式输出级。,当Y 输出高电平UH时,T4导通、T5截止;当Y 输出低电平UL时,T4截止、T5导通。,2019年6月17日,北京理工大学 信息科学学院,22,TTL“或非”门电路,A、B同为低电平:T1、T1导通,T2、T2、T5截止,T4导通。Y 输出高电平UH。,A为高电平、B为低电平:T1反向导通,T2、T5导通;T1导通、T2截止,T4截止。Y 输出低电平UL。,A、B同
10、为高电平:T1、T1反向导通,T2、T2、T5导通,T4截止。Y 输出低电平UL。,2019年6月17日,北京理工大学 信息科学学院,23,TTL“与或非”门电路,A、B输入端与输出端Y构成一个“与非”门。,C、D输入端与输出端Y构成一个“与非”门。,T2与T2的发射极电流在T 的基极输入端构成 “与”的关系:Y=Ie2Ie2,2019年6月17日,北京理工大学 信息科学学院,24,TTL“异或”门电路,A、B同为低电平:T1、T2、T3导通,T4、T5、T6截止,T7、T9导通,T8截止,Y 输出低电平UL。,A为高电平、B为低电平:T1 、T2导通,T4、T6截止;T3反向导通,T5导通,
11、T7、T9截止,T8导通,Y 输出高电平UH。,A、B同为高电平:T1、T2、T3反向导通,T4、T5、T6、T9导通,T7、T8截止,Y 输出低电平UL。,2019年6月17日,北京理工大学 信息科学学院,25,推拉式输出级并联的情况,Y1、Y2同时输出高电平或者同时输出低电平时,不会产生什么问题。,当Y1、Y2一个输出高电平而另一个输出低电平(比如Y1输出高电平Y2输出低电平)时,从电源UCC到Y1门的R4、T4、D3和Y2门的T5到“地”之间就形成了一条低阻回路,这条回路中将会有很大的电流通过,它将烧毁电源、门电路Y1、门电路Y2。,结论:对于具有推拉式输出级的门电路Y1、Y2,它们的输
12、出端在任何情况下都绝对不允许直接连接在一起。,2019年6月17日,北京理工大学 信息科学学院,26,3.4.2 TTL与非门的特性及参数,1.电压传输特性和静态参数,(1)电压传输特性,(b)电压传输特性曲线,2019年6月17日,北京理工大学 信息科学学院,27,电压传输特性曲线,(2)静态参数, 输出高电平UOH和输出低电平UOL。,UOH是电路中T5管处于截止状态时的输出电平,其典型值为3.4v。,UOL是电路中T5管处于导通状态时的输出电平,其典型值为0.3v。,对于74系列产品,UOH2.4v, UOL0.4v便认为产品合格。,UOH(min) = 2.4v称为输出高电平最小值,U
13、OL(max) = 0.4v称为输出低电平最大值。,2019年6月17日,北京理工大学 信息科学学院,28,UIH是输入逻辑状态“1”所对应的输入电平,其典型值为3.4v。, 输入高电平UIH和输入低电平UIL。,保证“与非”门输出低电平所允许的最小输入高电平UIH(min)= 2.0v,称为开门电平,记作UON。,UIL是输入逻辑状态“0”所对应的输入电平,其典型值为0.3v。,保证“与非”门输出高电平所允许的最大输入低电平UIL(max)= 0.8v,称为关门电平,记作UOFF。,“开门”、“关门”是相对于T5管而言的。T5管导通,门电路开门;T5管截至,门电路关门。,2019年6月17日
14、,北京理工大学 信息科学学院,29,低电平噪声容限电压UNL = UIL(max) UOL(max) = UOFF UOL(max) = 0.8 0.4 = 0.4 v。,高电平噪声容限电压UNH = UOH(min) UIH(min) = UOH(min) UON = 2.4 2.0 = 0.4 v。, TTL门电路的抗干扰特性噪声容限,2019年6月17日,北京理工大学 信息科学学院,30,UNL越大,表明“与非”门在输入为“0”态下的抗干扰能力越强。,由于TTL门电路的UNH与UNL均为0.4v,所以统称它们为噪声容限UN。,UNH越大,表明“与非”门在输入为“1”态下的抗干扰能力越强。
15、,低电平噪声容限电压:UNL = UIL(max) UOL(max) = 0.8 0.4 = 0.4 v。,高电平噪声容限电压:UNH = UOH(min) UIH(min) = 2.4 2.0 = 0.4 v。,2019年6月17日,北京理工大学 信息科学学院,31, TTL门电路的阈值电平UT,TTL“与非”门的输出高、低电平发生转换时所对应的输入电压称为TTL“与非”门电路的阈值电平UT,一般UT为1.4v左右。,2019年6月17日,北京理工大学 信息科学学院,32,2.输入、输出负载特性,(1)输入特性,2019年6月17日,北京理工大学 信息科学学院,33, 输入低电平电流IIL,
16、当ui= 0时,II = -1.1mA。,ui= 0.3 v 时的II叫做IIL。,2019年6月17日,北京理工大学 信息科学学院,34,IIL也叫灌电流,即后级门向前级门的输出端灌入电流。,2019年6月17日,北京理工大学 信息科学学院,35, 输入高电平电流IIH,当ui UT = 1.4 v时,II = 40A。,ui UT时的 II 叫做 IIH。,2019年6月17日,北京理工大学 信息科学学院,36,IIH也叫拉电流,即后级门从前级门的输出端拉出电流。,2019年6月17日,北京理工大学 信息科学学院,37,(2)输出特性, 输出低电平电流IOL,IOL是输出低电平时流入输出端
17、的电流。,2019年6月17日,北京理工大学 信息科学学院,38,IBS5IOL,IOL(max)一般为16mA。,IO IBS5=IOL(max)时, T5将脱离饱和状态,这将使得uO=uCE5 0.4 v从而不是输出低电平。,uO=UOL时的IO叫做IOL。,保证uO=uCE50.4v时的IO叫做IOL。,2019年6月17日,北京理工大学 信息科学学院,39, 输出高电平电流IOH,IOH是输出高电平时流出输出端的电流。,2019年6月17日,北京理工大学 信息科学学院,40,考虑到芯片(T4)功耗问题,一般取IOH(max) 为 5 mA。,IO IOH(max)时,会使uO 2.4
18、v从而使输出不是高电平。,uO=UOH时的IO叫做IOH。,保证uO2.4v时的IO叫做IOH。,2019年6月17日,北京理工大学 信息科学学院,41,(3)扇出系数,TTL“与非”门输出端能驱动同类“与非”门的最大个数称为扇出系数,用NO表示。,输出低电平时的扇出系数为:,输出高电平时的扇出系数为:,74系列TTL“与非”门的扇出系数一般取NO=10。特殊制作的驱动器集成门电路,其扇出系数可达NO=20 。,2019年6月17日,北京理工大学 信息科学学院,42,(4)输入端负载特性,2019年6月17日,北京理工大学 信息科学学院,43,TTL门电路输入端的外接电阻小于2K时,相当于输入
19、端接低电平,即:逻辑“0”。,TTL门电路输入端的外接电阻大于2K时,相当于输入端接高电平,即:逻辑“1”。,2019年6月17日,北京理工大学 信息科学学院,44,3.TTL“与非”门的动态特性,(1)平均传输延迟时间tpd。,输入电压上升到50%UIM至输出电压下降到50%UOM所需的时间称为导通延迟时间tpd1 。,输入电压下降到50%UIM至输出电压上升到50%UOM所需的时间称为截止延迟时间tpd2 。,导通延迟时间与截止延迟时间的平均值称为平均传输延迟时间tpd 。,2019年6月17日,北京理工大学 信息科学学院,45,74系列是普通(标准)型TTL门电路,它的平均传输延迟时间为
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