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1、一起看看“神器”究竟都有哪些?Hello!Everybody!今天陆妹给大家带来了三款神器,是我们EDA365特邀版主自主开发的哦。版主老师们不仅有着大咖的段位、浑身使不完的超强电子硬件技术能力,同时还有着一颗“造福”于工程师们的大爱之心,德玛西亚万岁!一起看看“神器”究竟都有哪些?(工具1毛老师提供;工具2杜老师提供;工具3贾老师提供。)01微带线阻抗计算小工具微带线阻抗计算(小工具)的结果与专业软件POLAR在相同输入条件下算出的结果进行比较:二者的阻抗结果居然小于1Ohm(51.66-51.30)!(其它不同数据组合精度会有差异,带状线的计算太易这个版本先不加)。结果比较:上图小工具除可
2、以提供微带线的准确计算外,还提给供了有效介电常,这个非常重要。02等长约束破解篇众(wu)所(zhi)周(wu)知(wei),对于数字信号通常要做时序控制,让同步信号能在彼此约定的时间内同时到达目的地。尤其是在设计高速PCB时,为了满足日益严格的时序要求,通常会对这些同步信号设置等长约束,使其电气长度相互接近。对于攻城狮而言,简单的点到点结构的同步信号,设置等长约束非常easy。But,对于有4、6、8、等多颗DDR芯片的ACC同步信号来说,要设置等长约束简直就是一场噩梦,不仅信号数量较多,而且拓扑结构十分复杂(如下图)。对于多负载的信号来说,在Allegro中通常有两种令攻城狮们喜闻乐见的等
3、长设置方法:【拓扑模版法】1【程序加载方法】(1)将作者免费提供的Auto_Create_Match_Group.il文件复制到HomePCBENV目录下(Home为系统环境变量);(2)编辑HomePCBENV目录下的allegro.ilinit文件(如无此文件,可新建文本文件,更名之),添加一行加载语句(建议按原文复制过去):loadi(./Auto_Create_Match_Group.il,dzkcool);(3)重启Allegro软件,在命令栏输入:auto_create_matchgroup;(4)有能力的小伙伴还可以修改Allegro的菜单文件allegro.men,添加菜单命令
4、(菜单文件修改需谨慎,注意提前做好备份);(5)这样就可以愉快的直接使用菜单命令了。2【程序使用说明】(1)将需要设置相对延时等长约束的同步总线创建到一个Netgroup或Bus中;(2)如果信号线上有串接的阻容器件(并联的不用管),需事先赋好模型,再创建Netgroup或Bus;(3)在插件程序中选择Bus后,再在From和To中分别选择起始点,设置好等长误差(默认为mil单位),单击Create后即可;(4)同一个Bus的多个负载可以在前一个MatchGroup单击Create后,直接选择新的负载,再次单击Create就能快速创建;(5)注意,本程序暂时不支持带T点的信号,使用前需清除信号
5、上的T点,此问题将在下一版解决。03丝印方向及位置调整【痛点】通常在后处理调整丝印时,Allegro Layout往往需要逐个调整丝印方向和位置,简单而机械的动作,需要耗费大量时间。由于人为操作,也很容易出现丝印交错现象,以致于设计完的PCB板出现严重质量问题。接下来我们通过SKILL程序来解决这个问题,无论多复杂的PCB板,一个”click“,就已调整好方向,并整齐地摆放于丝印框内。【功能】1、调整顶层和底层的丝印方向,并放置于器件丝印框内;2、顶层丝印按从左至右,从下至上摆放;底层丝印按从右至左、从下至上摆放。【应用】1、打开丝印未调整的Allegro brd文件;2、将“ref.il”程序文件(见附件)放置到brd文件同目录下;3、在Allegro命令窗口,输入:(load ref.il)加载程序,将返回:t,然后输入:(ref)执行丝印调整命令;4、检查丝印原来混乱的丝印,已调整好方向,并放置于器件丝印框内。其后,仅需将丝印成组移到合适的位置。
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