关于ispMACH4000系列CPLD的功能介绍.doc
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1、关于ispMACH4000系列CPLD的功能介绍Lattice ispLEVER开发工具中关于ispMACH4000系列CPLD的一些常用constraint选项要点如下:1 Dt_synthesisEDAYes: 允许fitter使用宏单元中的T触发器来节省乘积项(PT )资源。建议选Yes。2 Xor_synthesisYes: 允许fitter使用宏单元中的硬XOR门来节省乘积项(PT )资源。当寄存器的输入包含异步输入引脚信号时,由于目前ispLEVER版本优化时考虑不够全面,应避免使用Yes选项。否则,最好选Yes。3. Nodes_collapsing_modeFmax: 该选项以
2、速度性能为目标来优化逻辑。Area: 该选项以最佳资源利用率为目标来优化逻辑。Speed: 该选项以速度性能为目标且兼顾资源利用率来优化逻辑。一般情况下,如果没有性能要求时,而宏单元占用较多时,可考虑Area选项,尤其当Utilize Clock Enable选为No时。如果性能要求为首选时,可先考虑Fmax选项。而Speed选项在性能上接近Fmax选项,但资源利用率比Fmax选项好。以上选择方法适合大多数情况,但具体设计对这三种选项都作尝试,仍不失为可取的设计流程。4 Max_pterm_collapse该选项是指每个宏单元使用的最大乘积项数目。一般情况下,选缺省值。如宏单元数未超过器件最大
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- 关于 ispMACH4000 系列 CPLD 功能 介绍
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