基于ARM7内核的SWI软中断功能设计方案详解.doc
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1、基于ARM7内核的SWI软中断功能设计方案详解笔者在设计一项目时采用LPC2458。此CPU为ARM7内核,带512K字节的片内FLASH,98k字节的片内RAM,支持片外LOCAL BUS总线,可从片外NOR FLASH启动CPU.由于代码量较大,程序放在片外的NOR FLASH中。且存在片外NOR FLASH在运行程序时,需对片外的NOR FLASH擦写的需求。在设计中,片外NOR FLASH的大小为16M字节。其中2M规划为存放运行程序,剩余的空间用于产品运行日志,告警灯存储空间。因此存在着在程序运行时对片外NOR FLASH擦写的需求。如果程序正在正常运行的片外FLASH中去擦写FLA
2、SH,会存在总线冲突的问题,无法实现此功能。我们采用ARM7内核的SWI软中断功能来实现。ARM软中断原理(SWI)软中断(SWI)目前没有找到任何官方的正式定义。笔者尝试与硬中断对比定义如下:1.软中断发生的时间是由程序控制的,而硬中断发生的时间是随机的。2.软中断是由程序调用发生的,而硬中断是由外设引发的。3.硬中断处理程序要确保它能快速完成它的任务,这样程序执行时才不会等待较长的时间。在C程序中调用软件中断需要用到编译器的扩展功能,使用关键字_SWI来声明中断函数。注意软中断号码同时在函数定义时指定。_swi(0x24) void my_swi(void);这样当调用函数my_swi的时
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- 基于 ARM7 内核 SWI 中断 功能 设计方案 详解
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