多环频率合成器的设计原理及其对输出信号带来的影响分析.doc
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1、多环频率合成器的设计原理及其对输出信号带来的影响分析接收机质量和测试仪速度的提高对信号发生器性能提出了更为严苛的要求。随着频谱日益拥挤,通信行业必须开发新的调制技术,提高组件测试速度和性能及生产能力。因此,现在比以往更加需要经济高效的高质量信号源解决方案。和汽车到手机的演变类似,信号发生器的性能不断提高而价格却日益走低,客户和消费者不断要求获得更多的功能和性能且希望价格更低。RFIC 设计和手机生产测试要求信号源降低相噪,加快频率切换速度,这种要求通常来说是矛盾的。因此一般而言,性能优化往往只能针对其中一种要求或另一种要求,很少能够同时满足两种要求。Aeroflex S-Series信号发生器
2、采用了具有特点的频率合成器设计图1同时优化两方面的性能,在频率切换时间小于100 s的同时,1 GHz典型相噪低至-135 dBc/Hz,频偏20-kHz 图2。现代器件技术的进步实现了频率合成器设计的小型化和简单化,与前代产品相比,其尺寸和成本都有大幅的下降。在信号发生器体积更小、重量更轻的同时,其功能还可以随着产品的发展不断进行扩展。本文重点介绍这种频率合成器的设计原理及其对输出信号带来的影响。多环频率合成器多环频率合成器设计具有更宽的频率范围 (高达6 GHz)和极高的频率分辨率。这种特殊设计图2采用两个锁相环 (PLL)。一个提供可按粗调步长在所需范围内进行步进调整的高频、低噪声 RF
3、 信号。直接数字频率合成器 (DDS) 提供可在粗调步长内内插进行精密频率分辨的低频信号。两种信号输入第二个 PLL 生成最终输出信号。低噪声高频信号源尽管声表面波 (SAW) 振荡器一直是 1GHz 频段低噪声信号源,但采用倍增大功率 VHF 晶振仍是最好的方法。问题是高频晶振可以降低噪声,但会加大内插步长难度,低频晶振可以缩小步长,但会造成噪声成倍增加。为了解决这种矛盾,采用135MHz晶振和小数乘法器,信号频率范围967 MHz到1350 MHz,步长22.5 MHz,与 22.5MHz 晶振相比,采用135MHz晶振时本底噪声可改善16 dB。晶振设计人员面临相互矛盾的要求。良好相位噪
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