集成电路制造技术:(12)(13)(14)工艺集成与封装测试.ppt
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1、微电子工艺(5) -工艺集成与封装测试,第五单元 工艺集成与封装测试,2,第五单元 工艺集成与封装测试,第12章 工艺集成 第13章 工艺监控 第14章 封装与测试,第五单元 工艺集成与封装测试,3,第12章 工艺集成,12.1 金属化与多层互连 12.2 CMOS集成电路工艺 12.3 双极型集成电路工艺,第五单元 工艺集成与封装测试,4,12.1 金属化与多层互连,金属及金属性材料在芯片上的应用被称为金属化,形成的整个金属及金属性材料结构称金属化系统。 金属化材料可分为三类: 互连材料; 接触材料; MOSFET栅电极材料。,第五单元 工艺集成与封装测试,5,12.1 金属化与多层互连,互
2、连材料指将同一芯片内的各个独立的元器件连接成为具有一定功能的电路模块;接触材料是指直接与半导体材料接触的材料,以及提供与外部相连的连接点;MOSFET栅电极材料是作为MOSFET器件的一个组成部分,对器件的性能起着重要作用。,第五单元 工艺集成与封装测试,6,12.1.1 欧姆接触,欧姆接触指金属与半导体的接触电阻值远小于半导体本身电阻。 金/半接触的电流密度: 肖特基势垒高度: 接触电阻: 低掺杂接触电阻: 高掺杂接触电阻:,第五单元 工艺集成与封装测试,7,12.1.2 布线技术,集成电路对互连布线有以下要求: 布线材料有低的电阻率和良好的稳定性; 布线应具有强的抗电迁移能力; 布线材料可
3、被精细刻蚀,并具有抗环境侵蚀的能力; 布线材料易于淀积成膜,粘附性要好,台阶覆盖要好,并有良好的可焊性。,第五单元 工艺集成与封装测试,8,1、电迁移现象,在大电流密度作用下金属化引线的质量输运现象。质量输运沿电子流方向,结果在一方形成空洞,另一方形成小丘。 中值失效时间MTF 指50%互连线失效的时间 :,第五单元 工艺集成与封装测试,9,2、稳定性,金属与半导体之间的任何反应,都会对器件性能带来影响。如硅在铝中具有一定的固溶度,若芯片局部形成“热点”,硅会溶解进入铝层中,致使硅片表面产生蚀坑,进而出现尖楔现象,造成浅结穿通。克服这种影响的主要方法是选择与半导体接触稳定的金属类材料作为阻挡层
4、或在金属铝中加入少量半导体硅元素,使其含量达到或接近固溶度,这就避免了硅溶解进入铝层。,第五单元 工艺集成与封装测试,10,3、金属布线的工艺特性,附着性要好,指所淀积的金属薄膜与衬底硅片表面的氧化层等应具有良好的附着性。 台阶覆盖性好,是指如果衬底硅片表面存在台阶,在淀积金属薄膜时会在台阶的阴面和阳面间产生很大的淀积速率差,甚至在阴面角落根本无法得到金属的淀积。这样会造成金属布线在台阶处开路或无法通过较大的电流。,第五单元 工艺集成与封装测试,11,4、合金工艺,金属膜经过图形加工以后,形成了互连线。但是,还必须对金属互连线进行热处理,使金属牢固地附着于衬底硅片表面,并且在接触窗口与硅形成良
5、好的欧姆接触。这一热处理过程称为合金工艺。 合金工艺有两个作用:其一增强金属对氧化层的还原作用,从而提高附着力;其二是利用半导体元素在金属中存在一定的固溶度。,第五单元 工艺集成与封装测试,12,12.1.3 多层互连,多层互连,一方面可以使单位芯片面积上可用的互连布线面积成倍增加,允许可有更多的互连线;另一方面使用多层互连系统能降低因互连线过长导致的延迟时间的过长。因此,多层互连技术成为集成电路发展的必然。 多层互连系统主要由金属导电层和绝缘介质层组成。因此可从金属导电层和绝缘介质层的材料特性,工艺特性,以及互连延迟时间等多个方面来分析ULSI对多层互连系统的要求。,第五单元 工艺集成与封装
6、测试,13,12.1.3 多层互连,第五单元 工艺集成与封装测试,14,12.1.4 铜多层互连系统工艺流程,第五单元 工艺集成与封装测试,15,12.1.4 铜多层互连系统工艺流程,第五单元 工艺集成与封装测试,16,12.2 CMOS集成电路工艺,第五单元 工艺集成与封装测试,17,12.2.1 隔离工艺,在CMOS电路的一个反相器中,p沟和n沟MOSFET的源漏,都是由同种导电类型的半导体材料构成,并和衬底(阱)的导电类型不同,因此,MOSEET本身就是被pn结所隔离,即是自隔离。只要维持源/衬底pn结和漏/衬底pn结的反偏,MOSFET便能维持自隔离。而在pMOS和nMOS元件之间和反
7、相器之间的隔离通常是采用介质隔离。CMOS电路的介质隔离工艺主要是局部场氧化工艺和浅槽隔离工艺。,第五单元 工艺集成与封装测试,18,12.2.1 隔离工艺,1、局部场氧化工艺,第五单元 工艺集成与封装测试,19,12.2.1 隔离工艺,2、浅槽隔离工艺,第五单元 工艺集成与封装测试,20,12.2.2 阱工艺结构,第五单元 工艺集成与封装测试,21,12.2.3 薄栅氧化技术,栅氧化层是MOS器件的核心。随着器件尺寸的不断缩小,栅氧化层的厚度也要求按比例减薄,以加强栅控能力,抑制短沟道效应,提高器件的驱动能力和可靠性等。但随着栅氧化层厚度的不断减薄,会遇到一系列问题,如:栅的漏电流会呈指数规
8、律剧增;硼杂质穿透氧化层进入导电沟道等。为解决上述难题,通常采用超薄氮氧化硅栅代替纯氧化硅栅。氮的引入能改善SiO2/Si界面特性,因为Si-N键的强度比Si-H键、Si-OH键大得多,因此可抑制热载流子和电离辐射等所产生的缺陷。将氮引入到氧化硅中的另一个好处是可以抑制PMOS器件中硼的穿透效应,提高阈值电压的稳定性及器件的可靠性。,第五单元 工艺集成与封装测试,22,12.2.4 非均匀沟道掺杂,栅长缩短和短沟道效应这对矛盾可以通过非均匀沟道掺杂解决,即表面杂质浓度低,体内杂质浓度高。这种杂质结构的沟道具有栅阈值电压低,抗短沟道效应能力强的特点。这种非均匀沟道的形成有主要有两种工艺技术: 两
9、步注入工艺,第一步是形成低掺杂浅注入表面区;第二步是形成高掺杂深注入防穿通区。 在高浓度衬底上选择外延生长杂质浓度低的沟道层,即形成梯度沟道剖面。这种方法能获得低的阈值电压,高的迁移率和高的抗穿通电压,但寄生结电容和耗尽层电容大。,第五单元 工艺集成与封装测试,23,12.2.5 栅电极材料与难溶金属硅化物自对准工艺,第五单元 工艺集成与封装测试,24,12.2.6 源/漏技术与浅结形成,1、轻掺杂漏结构(LDD) 2、超浅源漏延伸区结构 3、晕圈反型杂质掺杂结构和大角度注入反型杂质掺杂结构,第五单元 工艺集成与封装测试,25,12.2.7 CMOS电路工艺流程,第五单元 工艺集成与封装测试,
10、26,12.2.7 CMOS电路工艺流程,第五单元 工艺集成与封装测试,27,12.2.7 CMOS电路工艺流程,第五单元 工艺集成与封装测试,28,12.3 双极型集成电路工艺,双极型集成电路的基本工艺大致可分为两大类:一类是需要在元件之间制作电隔离区的工艺,另一类是元件之间采取自然隔离的工艺。采用第一类工艺的主要有晶体管-晶体管逻辑(TTL)电路,射极耦合逻辑 (ECL)电路、肖特基晶体管-晶体管逻辑 (STTL)电路等。隔离工艺有pn结隔离,介质隔离及pn结-介质混合隔离。而采用元件之间自然隔离工艺的另一类电路主要是集成注入逻辑 (I2L)电路。,第五单元 工艺集成与封装测试,29,12
11、.3.1 隔离工艺,双极型电路采用的隔离方法主要有pn结隔离,介质隔离及pn结-介质混合隔离。,1、pn结隔离,第五单元 工艺集成与封装测试,30,12.3.1 隔离工艺,2、混合隔离,第五单元 工艺集成与封装测试,31,12.3.2 双极型集成电路工艺流程,第五单元 工艺集成与封装测试,32,12.3.2 双极型集成电路工艺流程,第五单元 工艺集成与封装测试,33,12.3.3 多晶硅在双极型电路中的应用,1、多晶硅发射极 采用多晶硅形成发射区接触可以大大改善晶体管的电流增益和缩小器件的纵向尺寸,获得更浅的发射结。 2、自对准发射极和基区接触,第五单元 工艺集成与封装测试,34,34,本章重
12、点,金属化与多层互连 CMOS集成电路工艺 双极型集成电路工艺,第五单元 工艺集成与封装测试,35,第13章 工艺监控,13.1 概述 13.2 实时监控 13.3 工艺检测片 13.4 集成结构测试图形,第五单元 工艺集成与封装测试,36,13.1 概述,所谓工艺监控就是借助于一整套检测技术和专用设备,监控整个生产过程,在工艺过程中,连续提取工艺参数,在工艺结束时,对工艺流程进行评估。 工艺过程检测内容包括硅与其它辅助材料检测和工艺检测两大部分。 材料检测; 工艺检测。,第五单元 工艺集成与封装测试,37,13.1 概述,工艺检测技术得到了迅速的提高,今后将主要向着三个方向发展: 工艺线实时
13、监控; 非破坏性检测,指对硅片直接进行检测; 非接触监测,指对硅片直接进行检测。 当前,工艺监控一般是同时采用三种方式: 1、通过工艺设备的监控系统,进行在线实时监控; 2、采用工艺检测片,通过对工艺检测片的测试跟踪了解工艺情况; 3、配置集成结构测试图形,通过对微电子测试图形的检测评估具体具体工艺,工艺设备,工艺流程。,第五单元 工艺集成与封装测试,38,13.2 实时监控,实时监控是指生产过程中通过监控装置对整个工艺线或具体工艺过程进行的实时监控,当监控装置探测到某一被测条件达到设定阈值,工艺线或具体工艺设备就自动进行工艺调整;或者报警(自停止),由操作人员及时进行工艺调整。,第五单元 工
14、艺集成与封装测试,39,13.3 工艺检测片,工艺检测片,又叫工艺陪片(简称陪片)。一般使用没有图形的大圆片,安插在所要监控的工序,陪着生产片(正片)一起流水,在该工序完成后取出,通过专用设备对陪片进行测试,提取工艺数据,从而实现对工艺流程现场的监控,并在下一工序之前就判定本工序为合格、或返工、或报废。,第五单元 工艺集成与封装测试,40,13.3.1 晶片检测,对晶片的检测包括对原始的抛光片和工艺过程中的晶片的检测。 对抛光片从三个方面进行检验,几何尺寸、外观缺陷和物理特性。 对工艺过程中的晶片的检测方法有化学腐蚀法、X射线形貌照相法和铜缀饰技术。,第五单元 工艺集成与封装测试,41,13.
15、3.2 氧化层检测,1、厚度测量,包括比色法、斜面干涉法、椭圆偏振法和分光光度计法。 2、针孔检测,包括化学腐蚀法、液晶显示、铜染色和MOS结构测试法等。 3、击穿特性检测,是MOS器件栅氧化膜和集成电路层间绝缘的电学特性和可靠性的一个重要量度。 4、C-V测量技术,广泛用于SiO2-Si界面性质的研究,高频C-V法已成为MOS工艺常规监测手段。可以测量:固定电荷密度、Na+密度等。,第五单元 工艺集成与封装测试,42,13.3.3 光刻工艺检测,对光刻工艺的检测包括:掩膜版和硅片平整度检测;掩膜版和硅片上图形的CD(Critical Dimension)尺寸检测;光刻胶厚度及针孔检测;掩膜版
16、缺陷及对准检测。,第五单元 工艺集成与封装测试,43,13.3.4 扩散层检测,1、薄层电阻测量,通常采用两种方法:四探针法和范德堡法。 2、结深测量,包括结的显示 、结深测量 和亚微米结深测量 。 3、杂质分布测量 ,包括阳极氧化剥层的微分电导法和扩展电阻法。,第五单元 工艺集成与封装测试,44,13.3.5 离子注入层检测,1、中、大剂量注入检测,检测方法与扩散层相同,只是检测的是载流子特性。 2、小剂量注入检测,检测方法有两次注入法、MOS晶体管阈值电压漂移法、脉冲C-V法和扩展电阻法等。 3、几种方法的比较,离子注入层中杂质原子的分布一般采用中子活化分析、放射性示踪法、二次离子质谱(S
17、IMS)、背散射(RBS)、和俄歇电子能谱(AES)等方法检测。,第五单元 工艺集成与封装测试,45,13.3.6 外延层检测,1、厚度测量 2、图形漂移和图形畸变的测量 3、电阻率测量 4、杂质分布和自掺杂分布测量,第五单元 工艺集成与封装测试,46,13.4 集成结构测试图形,微电子测试结构和测试图形必需满足两个准则: 1、要求通过对测试结构和测试图形的检测能获得正确的结果。因此,要根据电路设计要求和实际能达到的工艺条件来进行测试结构和测试图形设计。 2、要求由测试图形和测试结构能使用自动测量系统便捷地获取数据,自动测量系统应用最少的探针(或探测板)。,第五单元 工艺集成与封装测试,47,
18、13.4.1 微电子测试图形的功能与配置,1、微电子测试图形的功能 1)提取工艺、器件和电路参数,评价材料、设备、工艺和操作人员工作质量,实行工艺监控和工艺诊断; 2)制定工艺规范和设计规范; 3)建立工艺模拟、器件模拟和电路模拟的数据库; 4)考察工艺线的技术能力; 5)进行成品率分析和可靠性分析。,第五单元 工艺集成与封装测试,48,13.4.1 微电子测试图形的功能与配置,2、微电子测试图形的配置方式 全片式,即工艺陪片(PVW),这种类型是把测试图形周期性地重复排列在圆片上,形成PVW(Process Validation Wafer的简称)。 外围式,这是一种早期常用的方式。它由位于
19、每个电路(芯片)周围的测试结构所组成,用于工艺监控和可靠性分析。 插花式,这种方式是在圆片的选定位置用测试图形代替整个电路芯片,其数量和位置由需要而定。,第五单元 工艺集成与封装测试,49,13.4.2 几种常用的测试图形,1、薄层电阻测试图形,第五单元 工艺集成与封装测试,50,13.4.2 几种常用的测试图形,1、薄层电阻测试图形,第五单元 工艺集成与封装测试,51,13.4.2 几种常用的测试图形,1、薄层电阻测试图形,偏移方形十字形结构,第五单元 工艺集成与封装测试,52,13.4.2 几种常用的测试图形,1、薄层电阻测试图形,大正十字形结构,第五单元 工艺集成与封装测试,53,13.
20、4.2 几种常用的测试图形,1、薄层电阻测试图形,小正十字形结构,第五单元 工艺集成与封装测试,54,13.4.2 几种常用的测试图形,2、平面四探针测试图形,第五单元 工艺集成与封装测试,55,13.4.2 几种常用的测试图形,3、金属-半导体接触电阻测试图形,第五单元 工艺集成与封装测试,56,13.4.2 几种常用的测试图形,4、掩模套准测试结构,随着大规模、超大规模集成电路的发展,电路图形的线宽越来越小,光刻工艺中的套准问题变得越来超重要掩模套准测试结构就是用来检测套准误差的。 套准误差的定量测量可以用光学方法,也可以用电学方法。下面介绍几种与生产工艺相容的目测和电测的掩模套准测试结构
21、。,第五单元 工艺集成与封装测试,57,13.4.2 几种常用的测试图形,5、工艺缺陷测量随机缺陷测试结构,采用电学测试方法确定与基本工艺结构相关的缺陷及其密度分布,并可由此预测成品率的测试结构叫做随机缺陷测试结构。有下面几种: (1)铝条连续性测试结构 (2)接触链测试结构 (3)栅极链测试结构 (4)MOS晶体管阵列测试结构 (5)可选址CMOS反相器阵列测试结构 (6)环形振荡器,第五单元 工艺集成与封装测试,58,13.4.3 微电子测试图形实例,电路约27000个元件,存储单元用多晶硅做负载,外围电路用耗尽型MOS管做负载,采用标准5微米硅栅等平面工艺,芯片尺寸3.34.8mm2,在
22、75mm的硅片上对称插入5个测试图形。 特点:主要测试点排列在测试图形外围,18个主要测试点与电路芯片一样,可使用同样固定探针卡;每个电路芯片旁,放置了多晶硅负载电阻的测试结构,用于检测整个硅片上电阻的均匀性,以及由于光刻套偏时,浓掺杂的N+源漏横向扩散对多晶电阻值的影响,弥补了插入式测试图形采集数据的不足;除含有薄层电阻、电容、晶体管(增强和耗尽)、CD尺寸等常规测试结构外,特别针对存储器电路工艺结构的特点,设计了几组随机缺陷测试结构。,第五单元 工艺集成与封装测试,59,59,本章重点,实时监控 工艺检测片 集成结构测试图形,第五单元 工艺集成与封装测试,60,第14章 封装与测试,14.
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